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FPGA/ASIC
k1801
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项目作者：
1801BM1
项目描述 ：
1801 series ULA reverse engineering
高级语言：
Verilog
项目主页：
项目地址:
git://github.com/1801BM1/k1801.git
创建时间：
2018-10-25T07:15:33Z
项目社区：
https://github.com/1801BM1/k1801
开源协议：
Other
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