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FPGA/ASIC
如何更改Quartus II默认5000整数次迭代
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如何更改Quartus II默认5000整数次迭代
作者:
薄情
发布时间:
2025-01-09 02:20:08 (1月前)
转自:
错误(13356)循环必须在5000次迭代Quartus II中终止
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2 条回复
0#
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你咖喱人biss嗷
|
2019-08-31 10-32
通过以下方式更改迭代限制:
作业 - >设置 - >编译设置 - >高级设置(综合) - >常量Verilog循环的迭代限制
版本:18.1
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