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场景模型
RISC-V-Vector
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项目作者:
ic-lab-duth
项目描述 :
Vector processor for RISC-V vector ISA
高级语言:
SystemVerilog
项目主页:
项目地址:
git://github.com/ic-lab-duth/RISC-V-Vector.git
创建时间:
2020-01-27T10:08:51Z
项目社区:
https://github.com/ic-lab-duth/RISC-V-Vector
开源协议:
Other
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