项目描述 ：
Reusable Verilog Components

高级语言： Verilog

项目主页： https://hotwolf.github.io/RVC

项目地址: git://github.com/hotwolf/RVC.git

创建时间： 2019-05-20T20:29:19Z
项目社区：https://github.com/hotwolf/RVC
开源协议：
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