FPGA/ASIC logic-gates-hdl 返回
项目作者： nkyorov

项目描述 ：
Implementations of various logic gates in HDL
高级语言： Scilab
项目地址: git://github.com/nkyorov/logic-gates-hdl.git
创建时间： 2018-02-23T18:54:56Z
项目社区：https://github.com/nkyorov/logic-gates-hdl
开源协议：
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