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FPGA/ASIC
icestick-glitcher
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项目作者：
SySS-Research
项目描述 ：
Simple voltage glitcher implementation for the Lattice iCEstick Evaluation Kit
高级语言：
Verilog
项目主页：
项目地址:
git://github.com/SySS-Research/icestick-glitcher.git
创建时间：
2020-01-30T07:08:02Z
项目社区：
https://github.com/SySS-Research/icestick-glitcher
开源协议：
Other
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