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项目作者： oaxelou

项目描述 ：
Hardware - Verilog
高级语言： Verilog
项目地址: git://github.com/oaxelou/FPGAs.git
创建时间： 2018-10-04T17:58:16Z
项目社区：https://github.com/oaxelou/FPGAs
开源协议：
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