FPGA/ASIC USB_Ctrl 返回
项目作者： maxs-well

项目描述 ：
USB2.0 Verilog
高级语言： Verilog
项目地址: git://github.com/maxs-well/USB_Ctrl.git
创建时间： 2019-04-20T04:59:12Z
项目社区：https://github.com/maxs-well/USB_Ctrl
开源协议：GNU General Public License v2.0
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