Docker verilog-shift-register 返回
项目作者： abstractmachines

项目描述 ：
A shift register in Verilog. Bidirectional pin use.
高级语言： Verilog
项目地址: git://github.com/abstractmachines/verilog-shift-register.git
创建时间： 2016-03-29T07:42:03Z
项目社区：https://github.com/abstractmachines/verilog-shift-register
开源协议：
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